光模块电路板厂商,PCB多层板

软硬结合板的优缺点： 软硬结合板，就是柔性线路板与硬性线路板，经过压合等工序，按相关工艺要求组合在一起，形成的具有FPC特性与PCB特性的线路板。 因为软硬结合板是FPC与PCB的组合，软硬结合板的生产应同时具备FPC生产设备与PCB生产设备。 首先，由电子工程师根据需求画出软性结合板的线路与外形，然后，下发到可以生产软硬结合板的工厂，经过CAM工程师对相关文件进行处理、规划，然后安排FPC产线生产所需FPC、PCB产线生产PCB，这两款软板与硬板出来后，按照电子工程师的规划要求，将FPC与PCB经过压合机无缝压合，再经过一系列细节环节，较终就制成了软硬结合板。 很重要的一个环节，应为软硬结合板难度大，细节问题多，在出货之前，一般都要进行全检，因其价值比较高，以免让供需双方造成相关利益损失。 优点：软硬结合板同时具备FPC的特性与PCB的特性，因此，它可以用于一些有特殊要求的产品之中，既有一定的挠性区域，也有一定的刚性区域，对节省产品内部空间，减少成品体积，提高产品性能有很大的帮助。 缺点：软硬结合板生产工序繁多，生产难度大，良品率较低，所投物料、人力较多，因此，其价格比较贵，生产周期比较长。

FPC生产中常用的模切辅材，看看有哪些？ 生产FPC的工序繁杂，从开料钻孔到包装出货，中间所需要的工序有20多道，在这漫长的生产过程中，根据客户需求，将用到多种辅材。FPC的基材一般为双面或单面铜箔，这是整个FPC的基础，FPC的电气性能都由它决定。其他辅材只是用来辅助安装与适应使用环境。主要有下面几种： 1、FR4-质地较硬，有0.15-2.0mm的不同厚度，主要用在FPC焊接处的反面，作为加强，方便焊接稳定可靠； FR-4是一种耐燃材料等级的代号，所代表的意思是树脂材料经过燃烧状态必须能够自行熄灭的一种材料规格，它不是一种材料名称，而是一种材料等级，因此目**般电路板所用的FR-4等级材料就有非常多的种类，但是多数都是以所谓的四功能(Tera-Function)的环氧树脂加上填充剂(Filler)以及玻璃纤维所做出的复合材料。 2、PI胶带-质地较软，可弯曲，主要用在金手指区域的加厚加强，便于插拔； PI胶带，全名是聚酰亚胺胶带。PI胶带是以聚酰亚胺薄膜为基材，采用进口**硅压敏胶粘剂，具有耐高低温、耐酸碱、耐溶剂、电气绝缘（H级）、防辐射等性能。适用于电子线路板波峰焊锡遮蔽、保护金手指和高档电器绝缘、马达绝缘，以及锂电池正负极耳固定。 3、钢片-质地硬，功能与FR4一样，用于焊接处补强，比FR4美观，可接地，硬度较FR4高； 钢片，材料为原装进口不锈钢经热处理精磨加工制成,具有精密度高、拉力度强、光洁度好、有韧性、不易折断的特点。 4、TPX阻胶膜-一款高性能耐高温的树脂阻挡离型膜，用于线路板压合工序，经专门的工艺设计，可用于阻挡树脂溢出后埋孔和盲通孔的多次层压工序上，具有良好的阻胶、塞孔效果。 5、EIM电磁膜-贴于FPC表面，用于屏蔽信号干扰； EIM电磁膜是一种通过真空溅射的方法，可以在不同衬底的（PET/PC/玻璃等）基材上镀屏蔽材料，以较低的电阻实现EMI电磁干扰屏蔽。 6、导电胶-用于钢片与FPC的连接压合，导电，可实现钢片接地功能； 导电胶是一种固化或干燥后具有一定导电性的胶粘剂。主要由树脂基体、导电粒子和分散添加剂、助剂等组成。它可以将多种导电材料连接在一起，使被连接材料间形成电的通路。在电子工业中,导电胶已成为一种必不可少的新材料。 7、3M胶纸-主要用作于0.4mm及以上厚度的FR4与FPC粘贴，以及FPC与客户产品组装固定； FPC辅材的使用，较终要根据客户的使用环境与功能要求来决定。

PCB电路板无铅喷锡与有铅喷锡除了环保差异外，还有哪些区别呢？ 随着电子行业不断的发展，PCB的技术水平也在水涨船高，常见的表面处理工艺就有喷锡，沉金，镀金，OSP等；其中喷锡分为无铅喷锡和有铅喷锡。那么，PCB电路板无铅喷锡与有铅喷锡的区别在哪？ 1、无铅喷锡属于环保类工艺，不含有害物质"铅"，熔点在218度左右；锡炉温度需控制在280-300度；过波峰焊温度需控制在260度左右；过回流焊温度在260-270度左右。 2、有铅喷锡不属于环保类工艺，含有害物质"铅"，熔点183度左右；锡炉温度需控制在245-260度；过波峰焊温度需控制在250度左右；过回流焊温度在245-255度左右。 3、从锡的表面看，有铅锡比较亮，无铅锡比较暗淡；无铅板的浸润性要比有铅板的差一点。 4、无铅锡的铅含量不**过0.5 ，有铅锡的铅含量达到37。 5、铅会提高锡线在焊接过程中的活性，有铅锡线相对比无铅锡线好用；不过铅有毒，长期使用对人体不好。无铅锡比有铅锡熔点高，焊接点会牢固很多。 6、在pcb板表面处理中，通常做无铅喷锡和有铅喷锡的价格是一样的，没有区别。

高精密度(HDI板)电路板的耐热性介绍 HDI板的耐热性能是HDI可靠性能中重要的一个项目，HDI板的板厚变得越来越薄，对其耐热性能的要求也越来越高。无铅化进程的推进，也提高了HDI板耐热性能的要求，而且由于HDI板在层结构等方面不同于普通多层通孔PCB板，因此HDI板的耐热性能与普通多层通孔PCB板相比有所不同，一阶HDI板典型结构。HDI板的耐热性能缺陷主要是爆板和分层。到目前为止，根据多种材料以及多款HDI板的耐热性能测试的经验，发现HDI板发生爆板机率较大的区域是密集埋孔的上方以及大铜面的下方区域。 耐热性是指PCB抵抗在焊接过程中产生的热机械应力的能力， PCB在耐热性能测试中发生分层的机制一般包括以下几种： 1) 测试样品内部不同材料在温度变化时，膨胀和收缩性能不同而在样品内部产生内部热机械应力，从而导致裂缝和分层的产生。 2) 测试样品内部的微小缺陷(包括空洞，微裂纹等)，是热机械应力集中所在，起到应力的放大器的作用。在样品内部应力的作用下，更加容易导致裂缝或分层的产生。 3) 测试样品中挥发性物质(包括**挥发成分和水)，在高温和剧烈温度变化时，急剧膨胀产生巨大的内部蒸汽压力，当膨胀的蒸汽压力到达测试样品内部的微小缺陷(包括空洞，微裂纹等)时，微小缺陷对应的放大器作用就会导致分层。 HDI板容易在密集埋孔的上方发生分层，这是由于HDI板在埋孔分布区域特殊的结构所导致的。有无埋孔区域的应力分析如下表1。无埋孔区域(结构1)在耐热性能测试受热膨胀时，在同一平面上各个位置的Z方向的膨胀量都是均匀的，因此不会存在由于结构的差异造成的应力集中区域。当区域中设计有埋孔且埋孔钻在基材面上(结构2)时，在埋孔与埋孔之间的A-A截面上，由于基材没有收到埋孔在Z方向的约束，因而膨胀量较大，而在埋孔和焊盘所在的B-B截面上，由于基材受到埋孔在Z方向的约束，因而膨胀量较小，这三处膨胀量的差异，在埋孔焊盘与HDI介质和塞孔树脂交界处和附近区域造成应力集中，从而比较容易形成裂缝和分层。 HDI板容易在外层大铜面的下方发生分层，这是由于在贴装和焊接时，PCB受热，挥发性物质(包括**挥发成分和水)急剧膨胀，外层大铜面阻挡了挥发性物质(包括**挥发成分和水)的及时逸出，因此产生巨大的内部蒸汽压力，当膨胀的蒸汽压力到达测试样品内部的微小缺陷(包括空洞，微裂纹等)时，微小缺陷对应的放大器作用就会导致分层。

**实用的高频PCB电路设计70问答之一 1、如何选择PCB 板材？ 选择PCB板材必须在满足设计需求和可量产性及成本中间取得平衡点。设计需求包含电气和机构这两部分。通常在设计非常高速的 PCB 板子(大于 GHz 的频率)时这材质问题会比较重要。例如，现在常用的 FR-4 材质，在几个GHz 的频率时的介质损耗(dielectric loss)会对信号衰减有很大的影响，可能就不合用。就电气而言，要注意介电常数(dielectric constant)和介质损在所设计的频率是否合用。 2、如何避免高频干扰？ 避免高频干扰的基本思路是尽量降低高频信号电磁场的干扰，也就是所谓的串扰(Crosstalk)。可用拉大高速信号和模拟信号之间的距离，或加 ground guard/shunt traces 在模拟信号旁边。还要注意数字地对模拟地的噪声干扰。 3、在高速设计中，如何解决信号的完整性问题？ 信号完整性基本上是阻抗匹配的问题。而影响阻抗匹配的因素有信号源的架构和输出阻抗(output impedance)，走线的特性阻抗，负载端的特性，走线的拓朴(topology)架构等。解决的方式是靠端接(termination)与调整走线的拓朴。 4、差分布线方式是如何实现的？ 差分对的布线有两点要注意，一是两条线的长度要尽量一样长，另一是两线的间距(此间距由差分阻抗决定)要一直保持不变，也就是要保持平行。平行的方式有两种，一为两条线走在同一走线层(side-by-side)，一为两条线走在上下相邻两层(over-under)。一般以前者 side-by-side(并排, 并肩) 实现的方式较多。 5、对于只有一个输出端的时钟信号线，如何实现差分布线？ 要用差分布线一定是信号源和接收端也都是差分信号才有意义。所以对只有一个输出端的时钟信号是无法使用差分布线的。 6、接收端差分线对之间可否加一匹配电阻？ 接收端差分线对间的匹配电阻通常会加, 其值应等于差分阻抗的值。这样信号质量会好些。 7、为何差分对的布线要靠近且平行？ 对差分对的布线方式应该要适当的靠近且平行。所谓适当的靠近是因为这间距会影响到差分阻抗(differential impedance)的值, 此值是设计差分对的重要参数。需要平行也是因为要保持差分阻抗的一致性。若两线忽远忽近, 差分阻抗就会不一致, 就会影响信号完整性(** integrity)及时间延迟(timing delay)。 8、如何处理实际布线中的一些理论冲突的问题 基本上, 将模/数地分割隔离是对的。 要注意的是信号走线尽量不要跨过有分割的地方(moat), 还有不要让电源和信号的回流电流路径(returning current path)变太大。 晶振是模拟的正反馈振荡电路, 要有稳定的振荡信号, 必须满足loop gain 与 phase 的规范, 而这模拟信号的振荡规范很容易受到干扰, 即使加 ground guard traces 可能也无法完全隔离干扰。而且离的太远,地平面上的噪声也会影响正反馈振荡电路。 所以, 一定要将晶振和芯片的距离进可能靠近。 确实高速布线与 EMI 的要求有很多冲突。但基本原则是因 EMI 所加的电阻电容或 ferrite bead, 不能造成信号的一些电气特性不符合规范。 所以, 较好先用安排走线和 PCB 迭层的技巧来解决或减少 EMI的问题, 如高速信号走内层。最后才用电阻电容或 ferrite bead 的方式, 以降低对信号的伤害。 9、如何解决高速信号的手工布线和自动布线之间的矛盾？ 现在较强的布线软件的自动布线器大部分都有设定约束条件来控制绕线方式及过孔数目。各家 EDA公司的绕线引擎能力和约束条件的设定项目有时相差甚远。 例如, 是否有足够的约束条件控制蛇行线(serpentine)蜿蜒的方式, 能否控制差分对的走线间距等。 这会影响到自动布线出来的走线方式是否能符合设计者的想法。 另外, 手动调整布线的难易也与绕线引擎的能力有**的关系。 例如, 走线的推挤能力,过孔的推挤能力, 甚至走线对敷铜的推挤能力等等。 所以, 选择一个绕线引擎能力强的布线器, 才是解决之道。 10、关于 test coupon。 test coupon 是用来以 TDR (Time Domain Reflectometer) 测量所生产的 PCB 板的特性阻抗是否满足设计需求。 一般要控制的阻抗有单根线和差分对两种情况。 所以， test coupon 上的走线线宽和线距(有差分对时)要与所要控制的线一样。 较重要的是测量时接地点的位置。 为了减少接地引线(ground lead)的电感值， TDR 探棒(probe)接地的地方通常非常接近量信号的地方(probe tip)， 所以， test coupon 上量测信号的点跟接地点的距离和方式要符合所用的探棒。 11、在高速 PCB 设计中，信号层的空白区域可以敷铜，而多个信号层的敷铜在接地和接电源上应如何分配？ 一般在空白区域的敷铜绝大部分情况是接地。 只是在高速信号线旁敷铜时要注意敷铜与信号线的距离， 因为所敷的铜会降低一点走线的特性阻抗。也要注意不要影响到它层的特性阻抗， 例如在 dual strip line 的结构时。 12、是否可以把电源平面上面的信号线使用微带线模型计算特性阻抗？电源和地平面之间的信号是否可以使用带状线模型计算？ 是的， 在计算特性阻抗时电源平面跟地平面都必须视为参考平面。 例如四层板: **层-电源层-地层-底层，这时**层走线特性阻抗的模型是以电源平面为参考平面的微带线模型。 13、在高密度印制板上通过软件自动产生测试点一般情况下能满足大批量生产的测试要求吗？ 一般软件自动产生测试点是否满足测试需求必须看对加测试点的规范是否符合测试机具的要求。另外，如果走线太密且加测试点的规范比较严，则有可能没办法自动对每段线都加上测试点，当然，需要手动补齐所要测试的地方。 14、添加测试点会不会影响高速信号的质量？ 至于会不会影响信号质量就要看加测试点的方式和信号到底多快而定。基本上外加的测试点(不用在线既有的穿孔(via or DIP pin)当测试点)可能加在在线或是从在线拉一小段线出来。前者相当于是加上一个很小的电容在在线，后者则是多了一段分支。这两个情况都会对高速信号多多少少会有点影响，影响的程度就跟信号的频率速度和信号缘变化率(edge rate)有关。影响大小可透过仿真得知。原则上测试点越小越好(当然还要满足测试机具的要求)分支越短越好。 15、若干 PCB 组成系统，各板之间的地线应如何连接？ 各个 PCB 板子相互连接之间的信号或电源在动作时，例如 A 板子有电源或信号送到 B 板子，一定会有等量的电流从地层流回到 A 板子 (此为 Kirchoff current law)。这地层上的电流会找阻抗较小的地方流回去。所以，在各个不管是电源或信号相互连接的接口处，分配给地层的管脚数不能太少，以降低阻抗，这样可以降低地层上的噪声。另外，也可以分析整个电流环路，尤其是电流较大的部分，调整地层或地线的接法，来控制电流的走法(例如，在某处制造低阻抗，让大部分的电流从这个地方走)，降低对其它较敏感信号的影响。 16、能介绍一些国外关于高速 PCB 设计的技术书籍和数据吗？ 现在高速数字电路的应用有通信网路和计算器等相关领域。在通信网路方面，PCB 板的工作频率已达 GHz 上下，叠层数就我所知有到 40 层之多。计算器相关应用也因为芯片的进步，无论是一般的 PC 或服务器(Server)，板子上的较高工作频率也已经达到 400MHz (如 Rambus) 以上。因应这高速高密度走线需求，盲埋孔(blind/buried vias)、mircrovias 及 build-up 制程工艺的需求也渐渐越来越多。 这些设计需求都有厂商可大量生产。 17、两个常被参考的特性阻抗公式： 微带线(microstrip) Z={87/[sqrt(Er+1.41)]}ln[5.98H/(0.8W+T)] 其中，W 为线宽，T 为走线的铜皮厚度，H 为走线到参考平面的距离，Er 是 PCB 板材质的介电常数(dielectric constant)。此公式必须在0.1<(W/H)<2.0 及 1<(Er)<15 的情况才能应用。 带状线(stripline) Z=[60/sqrt(Er)]ln{4H/[0.67π(T+0.8W)]} 其中，H 为两参考平面的距离，并且走线位于两参考平面的中间。此公式必须在 W/H<0.35 及 T/H<0.25 的情况才能应用。 18、差分信号线中间可否加地线？ 差分信号中间一般是不能加地线。因为差分信号的应用原理较重要的一点便是利用差分信号间相互耦合(coupling)所带来的好处，如 flux cancellation，抗噪声(noise immunity)能力等。若在中间加地线，便会破坏耦合效应。 19、刚柔板设计是否需要**设计软件与规范？国内何处可以承接该类电路板加工？ 可以用一般设计 PCB 的软件来设计柔性电路板(Flexible Printed Circuit)。一样用 Gerber 格式给 FPC厂商生产。由于制造的工艺和一般 PCB 不同，各个厂商会依据他们的制造能力会对较小线宽、较小线距、较小孔径(via)有其**。除此之外，可在柔性电路板的转折处铺些铜皮加以补强。至于生产的厂商可上网“FPC”当关键词查询应该可以找到。 20、适当选择 PCB 与外壳接地的点的原则是什么？ 选择 PCB 与外壳接地点选择的原则是利用 chassis ground 提供低阻抗的路径给回流电流(returning current)及控制此回流电流的路径。例如，通常在高频器件或时钟产生器附近可以借固定用的螺丝将 PCB的地层与 chassis ground 做连接，以尽量缩小整个电流回路面积，也就减少电磁辐射。

**实用的高频PCB电路设计70问答 之四 36、对于全数字信号的 PCB，板上有一个 80MHz 的钟源。除了采用丝网（接地）外，为了保证有足够的驱动能力，还应该采用什么样的电路进行保护？ 确保时钟的驱动能力，不应该通过保护实现，一般采用时钟驱动芯片。一般担心时钟驱动能力，是因为多个时钟负载造成。采用时钟驱动芯片，将一个时钟信号变成几个，采用点到点的连接。选择驱动芯片，除了保证与负载基本匹配，信号沿满足要求（一般时钟为沿有效信号），在计算系统时序时，要算上时钟在驱动芯片内时延。 37、如果用单独的时钟信号板，一般采用什么样的接口，来保证时钟信号的传输受到的影响小？ 时钟信号越短，传输线效应越小。采用单独的时钟信号板，会增加信号布线长度。而且单板的接地供电也是问题。如果要长距离传输，建议采用差分信号。LVDS 信号可以满足驱动能力要求，不过您的时钟不是太快，没有必要。 38、27M,SDRAM 时钟线（80M-90M），这些时钟线二三次谐波刚好在 VHF 波段，从接收端高频窜入后干扰很大。除了缩短线长以外，还有那些好办法？ 如果是三次谐波大，二次谐波小，可能因为信号占空比为 50%，因为这种情况下，信号没有偶次谐波。这时需要修改一下信号占空比。此外，对于如果是单向的时钟信号，一般采用源端串联匹配。这样可以抑制二次反射，但不会影响时钟沿速率。源端匹配值，可以采用下图公式得到。 39、什么是走线的拓扑架构？ Topology,有的也叫 routing order.对于多端口连接的网络的布线次序。 40、怎样调整走线的拓扑架构来提高信号的完整性？ 这种网络信号方向比较复杂，因为对单向，双向信号，不同电平种类信号，拓朴影响都不一样，很难说哪种拓朴对信号质量有利。而且作前仿真时，采用何种拓朴对工程师要求很高，要求对电路原理，信号类型，甚至布线难度等都要了解。 41、怎样通过安排叠层来减少 EMI 问题？ 首先，EMI 要从系统考虑，单凭 PCB 无法解决问题。层迭对 EMI 来讲，我认为主要是提供信号较短回流路径，减小耦合面积，抑制差模干扰。另外地层与电源层紧耦合，适当比电源层外延，对抑制共模干扰有好处。 42、为何要铺铜？ 一般铺铜有几个方面原因。１，EMC.对于大面积的地或电源铺铜，会起到屏蔽作用，有些特殊地，如 PGND 起到防护作用。２，PCB 工艺要求。一般为了保证电镀效果，或者层压不变形，对于布线较少的PCB 板层铺铜。３，信号完整性要求，给高频数字信号一个完整的回流路径，并减少直流网络的布线。当然还有散热，特殊器件安装要求铺铜等等原因。 43、在一个系统中，包含了dsp和 pld，请问布线时要注意哪些问题呢？ 看你的信号速率和布线长度的比值。如果信号在传输在线的时延和信号变化沿时间可比的话，就要考虑信号完整性问题。另外对于多个 DSP，时 钟，数据 信号走线拓普也会影响信号质量和时序，需要关注。 44、除 protel 工具布线外，还有其他好的工具吗？ 至于工具，除了 PROTEL，还有很多布线工具，如 MENTOR 的 WG2000,EN2000 系列和 powerpcb，Cadence 的 allegro，zuken 的 cadstar,cr5000 等，各有所长。 45、什么是“信号回流路径”？ 信号回流路径,即 return current。高速数字信号在传输时，信号的流向是从驱动器沿 PCB 传输线到负载，再由负载沿着地或电源通过较短路径返回驱动器端。这个在地或电源上的返回信号就称信号回流路径。Dr.Johson 在他的书中解释，高频信号传输，实际上是对传输线与直流层之间包夹的介质电容充电的过程。SI 分析的就是这个围场的电磁特性，以及他们之间的耦合。 46、如何对接插件进行SI分析？ 在 IBIS3.2 规范中，有关于接插件模型的描述。一般使用 EBD 模型。如果是特殊板，如背板，需要SPICE 模型。也可以使用多板仿真软件（HYPERLYNX 或 IS_multiboard），建立多板系统时，输入接插件的分布参数，一般从接插件手册中得到。当然这种方式会不够精确，但只要在可接受范围内即可。 47、请问端接的方式有哪些？ 端接（terminal）,也称匹配。一般按照匹配位置分有源端匹配和终端匹配。其中源端匹配一般为电阻串联匹配，终端匹配一般为并联匹配，方式比较多，有电阻上拉，电阻下拉，戴维南匹配，AC 匹配，肖特基二极管匹配。 48、采用端接（匹配）的方式是由什么因素决定的？ 匹配采用方式一般由 BUFFER 特性，拓普情况，电平种类和判决方式来决定，也要考虑信号占空比，系统功耗等。 49、采用端接（匹配）的方式有什么规则？ 数字电路较关键的是时序问题，加匹配的目的是改善信号质量，在判决时刻得到可以确定的信号。对于电平有效信号，在保证建立、保持时间的前提下，信号质量稳定；对延有效信号，在保证信号延单调性前提下，信号变化延速度满足要求。Mentor ICX 产品教材中有关于匹配的一些资料。另外《High Speed Digital design a hand book of blackmagic》有一章专门对 terminal 的讲述，从电磁波原理上讲述匹配对信号完整性的作用，可供参考。 50、能否利用器件的 IBIS 模型对器件的逻辑功能进行仿真？如果不能，那么如何进行电路的板级和系统级仿真？ IBIS 模型是行为级模型，不能用于功能仿真。功能仿真，需要用 SPICE 模型，或者其他结构级模型。绝缘树脂:环氧树脂（EP）
阻燃特性:VO板
绝缘层厚度:常规板
层数:多面
基材:铜
绝缘材料:**树脂

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